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작성일: 2014.02.15
 

알테라의 Technology Roadshow 2010에 초대합니다

technology roadshow 2010

날짜:

2010년 10월 6일(수요일)
시간: 오전 9시 30분 – 오후 5시
장소: 롯데 호텔 월드 (3층 에머랄드룸, 2호선 잠실역하차, 대표번호: 419-7000, 주차권 가능)

Altera와 협력사들은 2010년 8월부터 11월까지 아시아태평양 지역의 16개 도시에서 무료 기술 세미나를 개최하고자 합니다. 세미나를 개최하는 국가는 중국, 인도, 한국, 말레이지아, 싱가포르, 대만입니다.

Technology Roadshow 2010에서는 Altera가 어떻게 최신 40nm 기술을 내놓으면서 FPGA 산업을 이끌어가고 있는지 보실 수 있습니다. 이 세미나에서는 Stratix V 및 IV FPGA, Arria II GX FPGA, Cyclone IV FPGA, 새로운 IP 및 솔루션을 비롯해서 Altera의 새로운 제품 포트폴리오를 이용해서 어떻게 오늘날 하이엔드 디지털 시스템 디자인의 과제를 해결하고 시스템 성능을 향상시킬 수 있을지 알게 됩니다.

초청 대상

  • 시스템 설계자
  • DSP 및 고속 디자인 엔지니어
  • FPGA 개발자
  • 엔지니어링 관리자
  • 기술 관리자

프리젠테이션과 시연회를 통해서 Altera 솔루션이 어떻게 Video and Image Processing(VIP) 디자인을 가속화하면서 성능을 향상시키고 출시시간을 단축할 수 있는지 설명합니다. 또한 차세대 솔루션을 위한 실제 사례를 통해서 어떻게 FPGA의 성능, 생산성, 비용 상의 이점을 실현할 수 있는지 설명합니다.

또한 Altera와 Linear Technology, Tektronix, The Mathworks, 브리시스 테크놀러지 등 협력 업체들의 다양한 혁신 기술을 선보이는 현장 데모를 보실 수 있습니다. 등록하시고 참석하시는 분들은 모든 프리젠테이션 자료와 Altera의 최신 자료를 받으실 수 있습니다.

등록 문의

Wintech윈텍코리아       박정현 사원    02-2057-5775 ext. 1259

지금바로등록하십시오!! 자리가 한정되어 있습니다!!

세미나 등록후 일찍 도착하시는 15분께 아놀드파마 골프 겸용 장우산을 드립니다.

세미나를 참석하시는 모든분께 중식, 자료집을 드리며, 종료후 설문지를 제출하시면 기념품을 드립니다.

세미나 종료 후 추첨을 통해 다양한 경품을 드립니다.

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Agenda

Time Duration Subject Speaker
09:30 - 09:50 20 min. Registration & see demo  
09:50 - 10:00 10 min. Introduction 김동훈 지사장/ALTERA
10:00 - 11:30 90 min.

Enabling high system performance with Altera new memory controller IP
- 파일명: PPT1_MemoryIP.ppt (4,962,304 bytes) * download *

박성만 차장/Uniquest
11:30 - 12:15 45 min.

Introducing 28-nm Stratix V FPGAs : Built for Bandwidth
- 파일명: PPT2_28nm.ppt (10,735,104 bytes) * download *

송대호 차장/Uniquest
12:15 - 01:30 75 min. Lunch time & see demo  
01:30 - 02:00 30 min.

Easily Build Designs using Altera's VIP Framework
- 파일명: PPT3_VIP.ppt (3,039,232 bytes) * download *

나희석 차장/WT
02:00 - 02:30 30 min.

PCI Express® Design with Altera's Transceivers
- 파일명: PPT4_PCIE.ppt (3,239,936 bytes) * download *

양창우 부장/WT
02:30 - 03:00 30 min.

Quickly Master Synopsys Design Constraint (SDC) Timing Analysis
- 파일명: PPT5_SDC.ppt (1,643,008 bytes) * download *

김현석 차장/WT
03:00 - 03:15 15 min. Break time  
03:15 - 03:45 30 min.

Implement Advanced Image Sensor Pipelines(ISP) for WDR CMOS Sensors with Altera FPGAs
- 파일명: PPT6_WDR.ppt (6,924,288 bytes) * download *

이영범 과장/Uniquest
03:45 - 04:45 60 min.

High Precision and efficiency - No Compromise with industry's first variable-precision DSP architecture (Altera 30 min + Mathworks 30 min)
- 파일명: PPT7A_DSP.ppt (5,499,392 bytes) * download *
- 파일명: PPT7B_Mathworks.ppt (1,845,760 bytes) * download *

최시연 차장/ALTERA
04:45 - 05:00 15 min. Lucky draw  
 

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